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Implementación eficiente de sistemas GALS sobre FPGAs
dc.creator | García Lasheras, Javier | es_ES |
dc.date.accessioned | 2017-08-18T10:39:26Z | |
dc.date.available | 2017-08-18T10:39:26Z | |
dc.date.issued | 2007 | |
dc.identifier.uri | https://hdl.handle.net/2454/25200 | |
dc.description | Trabajo presentado a las Jornadas de Computacion Reconfigurable y Aplicaciones (JCRA'07) = Spanish Workshop on Reconfigurable Computing and Applications, Zaragoza (2007) | es_ES |
dc.description | Versión en inglés en https://hdl.handle.net/2454/25201 | es_ES |
dc.description.abstract | Este artículo presenta un nuevo modelo para la implementación de Sistemas Globalmente Asíncronos – Localmente Síncronos (GALS) sobre Matrices de Puertas Programables por Campo (FPGA) comerciales. Esta nueva visión está orientada a disminuir la cantidad de lógica extra que trabajos previos en este campo muestran al aplicar técnicas GALS a dispositivos lógicos programables. La aproximación propuesta se fundamenta en un nuevo protocolo de handshaking basado en transiciones de paridad para las tareas de transferencia de datos y generación de reloj. La habilidad de la metodología presentada para seleccionar retardos de forma inteligente permite la implementación de una variedad de nuevas técnicas para la mitigación de interferencia electromagnética y la adaptación a los cambios del entorno del dispositivo. | es_ES |
dc.format.extent | 7 p. | |
dc.format.mimetype | application/pdf | en |
dc.language.iso | spa | en |
dc.subject | GALS | en |
dc.subject | FPGA | en |
dc.title | Implementación eficiente de sistemas GALS sobre FPGAs | es_ES |
dc.type | Contribución a congreso / Biltzarrerako ekarpena | es |
dc.type | info:eu-repo/semantics/conferenceObject | en |
dc.contributor.department | Ingeniería Eléctrica y Electrónica | es_ES |
dc.contributor.department | Ingeniaritza Elektrikoa eta Elektronikoa | eu |
dc.rights.accessRights | Acceso abierto / Sarbide irekia | es |
dc.rights.accessRights | info:eu-repo/semantics/openAccess | en |